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ダイレクトマップキャッシュの構成. 例： メモリアドレス＝３２ビット キャッシュ容量 C ＝ 256Kbyte C=B×A×S ブロックサイズ（ラインサイズ） B ＝３２ byte セット数（ブロック数、ライン数） S=8K アソシアティビティ A=1 ( ダイレクトマップは１ ). VALID １ビット. VALID １ビット. VALID １ビット. VALID １ビット. タグ １４ビット. タグ １４ビット. タグ １４ビット. タグ １４ビット. メモリアドレス＝３２ビット. タグ １４ビット. インデックス １３ビット. オフセット ５ビット.
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ダイレクトマップキャッシュの構成 例：メモリアドレス＝３２ビットキャッシュ容量C＝256KbyteC=B×A×Sブロックサイズ（ラインサイズ）B＝３２byteセット数（ブロック数、ライン数）S=8KアソシアティビティA=1 (ダイレクトマップは１) VALID １ビット VALID １ビット VALID １ビット VALID １ビット タグ １４ビット タグ １４ビット タグ １４ビット タグ １４ビット メモリアドレス＝３２ビット タグ１４ビット インデックス１３ビット オフセット５ビット タグメモリ部 データメモリ部 キャッシュライン 32 byte キャッシュライン 32 byte キャッシュライン 32 byte １３ビット 8K セット 8K セット キャッシュライン 32 byte 32 byteデータ ‘１’か？ 同じか？ マルチプレクサ ５ビット キャッシュヒット １byteデータ
VALID VALID VALID タグ タグ １６ビット タグ 物理ページ 物理ページ 物理ページ １６ｂ TLB 仮想メモリアドレス＝３２ビット 例：メモリアドレス＝３２ビットページサイズを６４Kバイト 仮想ページアドレス＝１６ビット ページ内 オフセット＝１６ビット TLB内のVALID=1であるすべて（フルアソシアティブの場合）のタグと仮想ページアドレスを比較して、一致（HIT）すれば、対応する物理アドレスを出力し、ページオフセットと連結して、物理アドレスを生成する。 物理ページアドレス＝１６ビット ページ内 オフセット＝１６ビット 物理メモリアドレス＝３２ビット
直列型物理アドレスキャッシュ 並列型物理アドレスキャッシュ 仮想メモリアドレス＝３２ビット 仮想メモリアドレス＝３２ビット 仮想ページアドレス＝１６ビット ページ内 オフセット＝１６ビット 仮想ページアドレス＝１６ビット ページ内 オフセット＝１６ビット TLB TLB 物理ページアドレス＝１６ビット ページ内 オフセット＝１６ビット 物理ページアドレス＝１６ビット 物理メモリアドレス＝３２ビット タグ１４ビット インデックス１３ビット オフセット５ビット タグ１７ビット インデックス１０ビット オフセット５ビット TAG DATA TAG DATA 比較 マルチプレクサ 比較 マルチプレクサ HIT/MISS HIT/MISS
