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FPGA (Field Programmable Gate Array). FPGA’s. 2do. Cuatrimestre de 2013. Sistemas Digitales - FIUBA. Lógica digital configurable. PLA (Programmable Logic Array) PAL (Programmable Array Logic) GAL (Gate Array Logic) CPLD (Complex Programmable Logic Device)
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FPGA (Field Programmable Gate Array)
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Lógica digital configurable • PLA (Programmable Logic Array) • PAL (Programmable Array Logic) • GAL (Gate Array Logic) • CPLD (Complex Programmable Logic Device) • FPGA (Field Programmable Gate Array)
FPGA’s • Elementos lógicos • Recursos de interconexión • Celdas de E/S 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Qué es una FPGA? • Es un dispositivo semiconductor conformado por bloques • de lógica, cuya interconexión y funcionalidad puede ser • configurada luego de su fabricación
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Ventajas de las FPGAs? • Prototipado rápido • Time to market corto • Capacidad para reconfiguración en campo • Ciclo de vida largo (reduce el riesgo de obsolescencia)
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Clasificación de las FPGAs • Volátiles • Una vez retirada la alimentación la configuración se pierde. • Para subsanar esta característica se utilizan memorias • externas tipo flash para conservar la configuración, la que • al momento del energizado se vuelca sobre la FPGA. • No volátiles
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Empresas fabricantes de FPGAs • Xilinx • Altera • Lattice Semiconductor • Microsemi (Actel) • QuickLogic
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Familia Spartan-3 • Dispositivo de la empresa Xilinx • Esta familia de FPGAs está orientada a necesidades de • alto volumen, sensibles a la variable costo
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Arquitectura • Consiste de 5 elementos programables fundamentales: • CLBs (Configurable Logic Blocks) • IOBs (Input/Output Blocks) • Block RAM • Multiplicadores • DCM (Digital Clock Manager)
FPGA’s CLBs 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Arquitectura
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: CLB
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Diagrama simplificado de un Slice
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Slices dentro del CLB
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Block RAM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Block RAM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Block RAM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Block RAM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: Multiplicador
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: DCM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: DCM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: DCM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: DCM
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: IOB
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA Spartan-3: IOB
FPGA’s 2do. Cuatrimestre de 2013 Sistemas Digitales - FIUBA FIN