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NEW BLP R&D. M. Uchida, Kyoto University. 開発の目的. 現行システムの老朽化( OS9,J11) に対応 ネットワークの高速化に対応 (100Base,1000Base) システム保守の単純化 (Open Source, Unix base) FORCE+Solaris を用いた DAQ の設計. ハードウエアについて. CES HSM or LeCroy Dual Port Memory FERA SYSTEM(ECL Readout) Universal Logic Unit (LR2366,2367)
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NEW BLP R&D M. Uchida, Kyoto University
開発の目的 • 現行システムの老朽化(OS9,J11)に対応 • ネットワークの高速化に対応(100Base,1000Base) • システム保守の単純化(Open Source, Unix base) • FORCE+Solarisを用いたDAQの設計
ハードウエアについて • CES HSM or LeCroy Dual Port Memory • FERA SYSTEM(ECL Readout) • Universal Logic Unit (LR2366,2367) • REPIC RPV130 I/O Register • LeCroy 1151N 32bit Scaler • K2917+K3922(VME – CAMAC interface) • FORCE CPU (CPU5CE,CPU7V,CPU54T)
ハードウエア概念図 • 基本的な構成は現行のメインシステム( GR, LAS, FPP)と同じ • ダブルバッファによるデータ転送系 • VMEの制御がOS9(J11)からFORCEへと移行する
開発状況 • VMEの各モジュールは動作確認済み • K2917-K3922の通信はKEK井上さんのプログラムにより動作確認済み • ECLReadout + Buffer Changer については擬似データを流して確認 • Kasugaへのデータ転送プログラム
データ転送の概念図 • Socket + IPC • Multi-threading • Client/Server • C言語ベース • 誰でも拡張可能
テスト実験の目的 • データ転送の確認 • 各モジュールのデータ整合性の確認 • テストデータではわからないバグの発見 • 長期安定性の確認
Input register for event selection • SPIN up/down • Internal counter • BLP1/BLP2 event • True/Chance
Beam polarization Mac scaler vs Frc scaler\ • Bean: pol-p 250MeV • Pn = 0.6 • 58Ni(p,p) reaction • Angle = 16.5 – 23.0
結果と問題点 • ADC/TDC 信号は正しく転送されている。 • Scalerの整合性がない。(~0.05%) • アナライザ、レコーダーの接続部分のバグ
LeCroy 1151Nについて • 32bit scalerと称しているが25bit目に1が立ってしまうというバグあり。 • 内部クロックがCAENのscalerと違う(CAEN 110MHz, LeCroy 80MHz)
補足1(現行システムの保守etc…) • Mari のミラーリングマシンを立ち上げた • FDDI, Reflective Memoryの動作確認済み • イニシャライズなどの部分はすでに移行可能 • Solaris8ブートサーバを立ち上げた。今後は2.6から8にすべて移行する予定。 • Gigabit Ethernet の動作確認。
補足2(スケーラのバグについて) • 単体試験の結果 LeCroy1151Nは正常に稼動している。 • 不整合はランコントローラとstart gate(j11_run)の同期がとれていなかったため。
まとめ • FORCE CPU + SolarisによるDAQシステムの開発は順調に進行中 • どのタイミングで導入しよう?(BLPだけならばそろそろ可能?) • 問題点としては現行システムのアナライザへの対応