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GESTIONE INTERRUPT CPU INTEL 8086

GESTIONE INTERRUPT CPU INTEL 8086. Prof. Marco Solarino. LINEE COINVOLTE. CPU 8086. INTR. RICHIESTE. NMI. INTA. RISPOSTA. 00. 01. 02. NN. FF. IVT.

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GESTIONE INTERRUPT CPU INTEL 8086

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Presentation Transcript

  1. GESTIONE INTERRUPT CPU INTEL 8086 Prof. Marco Solarino

  2. LINEE COINVOLTE CPU 8086 INTR RICHIESTE NMI INTA RISPOSTA

  3. 00 01 02 NN FF IVT La IVT (Interrupt Vector Table – Tabella dei Vettori di Interruzione), utilizzata per gestire l'interrupt in modo vettorizzato, è posizionata all'inizio della RAM, all'indirizzo 00000H. Contiene 256 elementi numerati da 00H a FFH. Ciascun elemento occupa 4 byte e contiene l'indirizzo logico (CS:IP) di una ISR, quindi in totale la IVT occupa 1 KB di memoria.

  4. 8 8 COLLEGAMENTI CPU 8086 INTR PERIFERICA INTA NN BUS DATI

  5. CPU 8086 INTR PERIFERICA INTA 8 8 BUS DATI COSA AVVIENE 1 IF=1 2 3 NN

  6. IVT 00 CS, IP, FLAG 01 02 NN FF COSA FA LA CPU 5 4 CPU 8086 IF=0 6 CS:IP STACK

  7. ...E POI CHE SUCCEDE? La CPU esegue la ISR. L'ultima istruzione della ISR è una IRET, che provoca il recupero di CS, IP e FLAG dallo stack. La CPU ritorna ad eseguire il programma che era stato interrotto.

  8. ATTENZIONE! Le ISR sono simili alle funzioni chiamate da un programma principale, ma ci sono differenze importanti: - la chiamata non avviene per via software, nel momento deciso dal programmatore, ma arriva via hardware dalla periferica interessata; - al momento della chiamata di una funzione vengono salvati CS e IP, mentre alla chamata della ISR si salvano CS, IP e FLAG.

  9. CONCLUSIONI La CPU 8086 gestisce le interruzioni tramite i piedini INTR, NMI e INTA. La tecnica utilizzata è quella dell'interrupt vettorizzato, che prevede l'uso della IVT. I processori successivi hanno introdotto tecniche di gestione dell'interrupt più complesse, sempre però compatibili con le precedenti, per sfruttare appieno le nuove funzionalità delle architetture IA-32 e IA-64.

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